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根据CMMB中LDPC码校验矩阵的结构特点,提出了一种部分并行译码结构的实现方法,并在XILINX的VirtexⅣ的XC4VLX80型FPGA上实现了这种结构.该设计充分利用了LDPC校验矩阵的规律,采用了一种适当的硬件结构和独特的存储器调用控制策略,故可在保证高性能和较大吞吐率的情况下,以较少的硬件资源实现两种码率的复用.
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电子元器件应用
ISSN： 1563-4795
Year： 2010
Issue： 10
Volume： 12
Page： 69-72
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